Schoenberger, Alex ; Hofmann, Klaus (2015)
Analysis of asymmetric 3D DRAM Architecture in combination with L2 Cache Size Reduction.
13th International Conference on High Performance Computing & Simulation (HPCS 2015). Amsterdam, Netherlands (20.07.2015-24.07.2015)
doi: 10.1109/HPCSim.2015.7237030
Konferenzveröffentlichung, Bibliographie
| Typ des Eintrags: | Konferenzveröffentlichung |
|---|---|
| Erschienen: | 2015 |
| Autor(en): | Schoenberger, Alex ; Hofmann, Klaus |
| Art des Eintrags: | Bibliographie |
| Titel: | Analysis of asymmetric 3D DRAM Architecture in combination with L2 Cache Size Reduction |
| Sprache: | Englisch |
| Publikationsjahr: | 25 Juli 2015 |
| Verlag: | IEEE |
| Buchtitel: | Proceedings of the 2015 International Conference on High Performance Computing & Simulation |
| Veranstaltungstitel: | 13th International Conference on High Performance Computing & Simulation (HPCS 2015) |
| Veranstaltungsort: | Amsterdam, Netherlands |
| Veranstaltungsdatum: | 20.07.2015-24.07.2015 |
| DOI: | 10.1109/HPCSim.2015.7237030 |
| Fachbereich(e)/-gebiet(e): | 18 Fachbereich Elektrotechnik und Informationstechnik 18 Fachbereich Elektrotechnik und Informationstechnik > Institut für Datentechnik 18 Fachbereich Elektrotechnik und Informationstechnik > Institut für Datentechnik > Integrierte Elektronische Systeme (IES) |
| Hinterlegungsdatum: | 05 Apr 2016 09:10 |
| Letzte Änderung: | 15 Aug 2024 09:39 |
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